信号は通常、デジタル電子回路のアナログレベルの離散帯域によって表されます。 デジタルエレクトロニクス アナログ電子機器で表される連続範囲の代わりに。ブール論理関数の単純な電子表現である論理ゲートの大規模なアセンブリは、通常、デジタル電子回路を作成するために使用されます。デジタル回路理論では、このように論理ゲートから形成された回路を使用して、入力ロジックに基づいて出力を生成します。したがって、これらの回路は論理回路と呼ばれ、順序論理回路と組み合わせ論理回路の2つのタイプに分類されます。
論理回路
ザ・ 論理ゲート ブール関数を実装するために使用される単純な物理デバイスとして定義できます。論理ゲートは、1つ以上の入力で論理演算を実行し、論理出力を生成するために使用されます。これらの論理回路は、1つまたは複数の論理ゲートを相互に接続することによって形成されます。これらの論理回路は、順序論理回路と組み合わせ論理回路の2種類に分類されます。
組み合わせ論理回路
この記事では、論理回路の紹介、組み合わせ論理回路、組み合わせ論理回路の定義、組み合わせ論理回路の設計、組み合わせ論理の機能について説明します。
組み合わせ論理回路の定義
デジタル回路理論における組み合わせ論理回路または時間に依存しない論理回路は、ブール回路を使用して実装される一種のデジタル論理回路として定義することができ、論理回路の出力は現在の入力のみの純粋関数である。組み合わせ論理回路の動作は瞬時に行われ、これらの回路にはメモリまたはフィードバックループがありません。
この組み合わせ論理は、出力が現在の入力と前の入力の両方に依存する順序論理回路とは対照的です。したがって、組み合わせロジックにはメモリがないのに対し、シーケンシャルロジックは以前の入力をメモリに格納していると言えます。したがって、組み合わせ論理回路の入力が変化すると、出力も変化します。
組み合わせ論理回路設計
組み合わせ論理回路
これらの組み合わせ 論理回路 特定の入力から特定の出力を生成するように設計されています。組み合わせ論理設計は、積の合計と合計の積などの2つの方法を使用して実行できます。組み合わせ論理回路は、一般に、NAND、NOR、NOTなどの基本的な論理ゲートを相互に接続または組み合わせることによって設計されます。したがって、これらの論理ゲートはビルディングブロックと呼ばれます。これらの論理回路は、非常に単純な回路でも、非常に複雑な回路でも、NANDゲートやNORゲートなどのユニバーサル論理ゲートのみを使用して設計できる巨大な組み合わせ回路でもかまいません。
組み合わせ論理回路の機能
組み合わせ論理回路の機能は、次の3つの主な方法で指定できます。
- 真理値表
- ブール代数
- 論理図
真理値表
組み合わせ論理関数の真理値表
論理ゲート関数は、論理ゲートの入力のすべての可能な組み合わせの出力で構成される真理値表を使用して定義できます。組み合わせ論理関数の真理値表の例を上の図に示します。
ブール代数
組み合わせ論理関数ブール式
組み合わせ論理関数の出力は、以下を使用した形式式で表すことができます。 ブール代数 例として、上記の真理値表のブール式を上の図に示します。
論理図
論理ゲートを使用した組み合わせ論理回路
論理ゲートを使用した組み合わせ論理関数のグラフィック表現は、論理図と呼ばれます。上記の論理関数の真理値表とブール式の論理図は、上の図に示すように実現できます。
組み合わせ論理回路は、個々の論理ゲートを使用して設計されているため、意思決定回路と呼ぶこともできます。組み合わせ論理は、論理ゲートを組み合わせて、所与の２つ以上の入力を処理し、各論理ゲートの論理機能に基づいて少なくとも１つの出力信号を生成するプロセスである。
組み合わせ論理の分類
組み合わせ論理の分類
組み合わせ論理回路は、算術・論理関数、データ伝送、コード変換など、使用目的に応じてさまざまなタイプに分類できます。算術関数と論理関数を解くために、通常、加算器、減算器、および コンパレータ これらは一般に、組み合わせ論理回路と呼ばれるさまざまな論理ゲートを組み合わせることによって実現されます。同様に、データ伝送には、マルチプレクサ、デマルチプレクサ、エンコーダ、およびデコーダを使用します。これらも組み合わせロジックを使用して実現されます。バイナリ、BCD、7セグメントなどのコードコンバータは、さまざまな論理回路を使用して設計されています。
実際、組み合わせロジックは、マルチプレクサおよびデマルチプレクサタイプの回路で最も頻繁に使用されます。複数の入力または出力が共通の信号ラインに接続されている場合、単一のデータ入力または出力スイッチを選択するために、論理ゲートを使用してアドレスをデコードします。
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